UltraCoder/Arkanoid2PDE1
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Arkanoid2PDE1/myArkanoid.fit.rpt
Kirill Kirilenko baf891d878 Version 1.0 released. 
Implemented features: ball moving, platform moving, showing scores on digital table, game reset.
2012-05-28 19:06:42 +04:00

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Fitter report for myArkanoid
Mon May 28 14:22:25 2012
Quartus II Version 9.1 Build 222 10/21/2009 SJ Full Version
---------------------
; Table of Contents ;
---------------------
1. Legal Notice
2. Fitter Summary
3. Fitter Settings
4. Parallel Compilation
5. Incremental Compilation Preservation Summary
6. Incremental Compilation Partition Settings
7. Incremental Compilation Placement Preservation
8. Pin-Out File
9. Fitter Resource Usage Summary
10. Input Pins
11. Output Pins
12. I/O Bank Usage
13. All Package Pins
14. Output Pin Default Load For Reported TCO
15. Fitter Resource Utilization by Entity
16. Delay Chain Summary
17. Pad To Core Delay Chain Fanout
18. Control Signals
19. Global & Other Fast Signals
20. Non-Global High Fan-Out Signals
21. Interconnect Usage Summary
22. LAB Logic Elements
23. LAB-wide Signals
24. LAB Signals Sourced
25. LAB Signals Sourced Out
26. LAB Distinct Inputs
27. Fitter Device Options
28. Operating Settings and Conditions
29. Estimated Delay Added for Hold Timing
30. Fitter Messages
31. Fitter Suppressed Messages
----------------
; Legal Notice ;
----------------
Copyright (C) 1991-2009 Altera Corporation
Your use of Altera Corporation's design tools, logic functions
and other software and tools, and its AMPP partner logic
functions, and any output files from any of the foregoing
(including device programming or simulation files), and any
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Subscription Agreement, Altera MegaCore Function License
Agreement, or other applicable license agreement, including,
without limitation, that your use is for the sole purpose of
programming logic devices manufactured by Altera and sold by
Altera or its authorized distributors. Please refer to the
applicable agreement for further details.
+-------------------------------------------------------------------------------+
; Fitter Summary ;
+------------------------------------+------------------------------------------+
; Fitter Status ; Successful - Mon May 28 14:22:24 2012 ;
; Quartus II Version ; 9.1 Build 222 10/21/2009 SJ Full Version ;
; Revision Name ; myArkanoid ;
; Top-level Entity Name ; TotalScheme ;
; Family ; Cyclone II ;
; Device ; EP2C20F484C7 ;
; Timing Models ; Final ;
; Total logic elements ; 7,148 / 18,752 ( 38 % ) ;
; Total combinational functions ; 7,096 / 18,752 ( 38 % ) ;
; Dedicated logic registers ; 1,086 / 18,752 ( 6 % ) ;
; Total registers ; 1086 ;
; Total pins ; 55 / 315 ( 17 % ) ;
; Total virtual pins ; 0 ;
; Total memory bits ; 0 / 239,616 ( 0 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 52 ( 0 % ) ;
; Total PLLs ; 0 / 4 ( 0 % ) ;
+------------------------------------+------------------------------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Settings ;
+----------------------------------------------------------------------------+--------------------------------+--------------------------------+
; Option ; Setting ; Default Value ;
+----------------------------------------------------------------------------+--------------------------------+--------------------------------+
; Device ; EP2C20F484C7 ; ;
; Minimum Core Junction Temperature ; 0 ; ;
; Maximum Core Junction Temperature ; 85 ; ;
; Fit Attempts to Skip ; 0 ; 0.0 ;
; Use smart compilation ; Off ; Off ;
; Enable parallel Assembler and TimeQuest Timing Analyzer during compilation ; On ; On ;
; Enable compact report table ; Off ; Off ;
; Use TimeQuest Timing Analyzer ; Off ; Off ;
; Router Timing Optimization Level ; Normal ; Normal ;
; Placement Effort Multiplier ; 1.0 ; 1.0 ;
; Router Effort Multiplier ; 1.0 ; 1.0 ;
; Always Enable Input Buffers ; Off ; Off ;
; Optimize Hold Timing ; IO Paths and Minimum TPD Paths ; IO Paths and Minimum TPD Paths ;
; Optimize Multi-Corner Timing ; Off ; Off ;
; PowerPlay Power Optimization ; Normal compilation ; Normal compilation ;
; Optimize Timing ; Normal compilation ; Normal compilation ;
; Optimize Timing for ECOs ; Off ; Off ;
; Regenerate full fit report during ECO compiles ; Off ; Off ;
; Optimize IOC Register Placement for Timing ; On ; On ;
; Limit to One Fitting Attempt ; Off ; Off ;
; Final Placement Optimizations ; Automatically ; Automatically ;
; Fitter Aggressive Routability Optimizations ; Automatically ; Automatically ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; PCI I/O ; Off ; Off ;
; Weak Pull-Up Resistor ; Off ; Off ;
; Enable Bus-Hold Circuitry ; Off ; Off ;
; Auto Global Memory Control Signals ; Off ; Off ;
; Auto Packed Registers ; Auto ; Auto ;
; Auto Delay Chains ; On ; On ;
; Auto Merge PLLs ; On ; On ;
; Ignore PLL Mode When Merging PLLs ; Off ; Off ;
; Perform Physical Synthesis for Combinational Logic for Fitting ; Off ; Off ;
; Perform Physical Synthesis for Combinational Logic for Performance ; Off ; Off ;
; Perform Register Duplication for Performance ; Off ; Off ;
; Perform Logic to Memory Mapping for Fitting ; Off ; Off ;
; Perform Register Retiming for Performance ; Off ; Off ;
; Perform Asynchronous Signal Pipelining ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
; Stop After Congestion Map Generation ; Off ; Off ;
; Save Intermediate Fitting Results ; Off ; Off ;
; Force Fitter to Avoid Periphery Placement Warnings ; Off ; Off ;
; Use Best Effort Settings for Compilation ; Off ; Off ;
+----------------------------------------------------------------------------+--------------------------------+--------------------------------+
+------------------------------------------+
; Parallel Compilation ;
+----------------------------+-------------+
; Processors ; Number ;
+----------------------------+-------------+
; Number detected on machine ; 2 ;
; Maximum allowed ; 2 ;
; ; ;
; Average used ; 1.20 ;
; Maximum used ; 2 ;
; ; ;
; Usage by Processor ; % Time Used ;
; 1 processor ; 100.0% ;
; 2 processors ; 11.1% ;
+----------------------------+-------------+
+-----------------------------------------------+
; Incremental Compilation Preservation Summary ;
+-------------------------+---------------------+
; Type ; Value ;
+-------------------------+---------------------+
; Placement ; ;
; -- Requested ; 0 / 8242 ( 0.00 % ) ;
; -- Achieved ; 0 / 8242 ( 0.00 % ) ;
; ; ;
; Routing (by Connection) ; ;
; -- Requested ; 0 / 0 ( 0.00 % ) ;
; -- Achieved ; 0 / 0 ( 0.00 % ) ;
+-------------------------+---------------------+
+--------------------------------------------------------------------------------------------------------------------------------------------------+
; Incremental Compilation Partition Settings ;
+----------------+----------------+-------------------+-------------------------+------------------------+------------------------------+----------+
; Partition Name ; Partition Type ; Netlist Type Used ; Preservation Level Used ; Netlist Type Requested ; Preservation Level Requested ; Contents ;
+----------------+----------------+-------------------+-------------------------+------------------------+------------------------------+----------+
; Top ; User-created ; Source File ; N/A ; Source File ; N/A ; ;
+----------------+----------------+-------------------+-------------------------+------------------------+------------------------------+----------+
+--------------------------------------------------------------------------------------------+
; Incremental Compilation Placement Preservation ;
+----------------+---------+-------------------+-------------------------+-------------------+
; Partition Name ; # Nodes ; # Preserved Nodes ; Preservation Level Used ; Netlist Type Used ;
+----------------+---------+-------------------+-------------------------+-------------------+
; Top ; 8242 ; 0 ; N/A ; Source File ;
+----------------+---------+-------------------+-------------------------+-------------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in G:/Verilog/Arkanoid2PDE1/myArkanoid.pin.
+-------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+---------------------------------------------------------------------------------------------------+
; Resource ; Usage ;
+---------------------------------------------+---------------------------------------------------------------------------------------------------+
; Total logic elements ; 7,148 / 18,752 ( 38 % ) ;
; -- Combinational with no register ; 6062 ;
; -- Register only ; 52 ;
; -- Combinational with a register ; 1034 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 2860 ;
; -- 3 input functions ; 2246 ;
; -- <=2 input functions ; 1990 ;
; -- Register only ; 52 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 5409 ;
; -- arithmetic mode ; 1687 ;
; ; ;
; Total registers* ; 1,086 / 19,649 ( 6 % ) ;
; -- Dedicated logic registers ; 1,086 / 18,752 ( 6 % ) ;
; -- I/O registers ; 0 / 897 ( 0 % ) ;
; ; ;
; Total LABs: partially or completely used ; 521 / 1,172 ( 44 % ) ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 55 / 315 ( 17 % ) ;
; -- Clock pins ; 1 / 8 ( 13 % ) ;
; Global signals ; 1 ;
; M4Ks ; 0 / 52 ( 0 % ) ;
; Total block memory bits ; 0 / 239,616 ( 0 % ) ;
; Total block memory implementation bits ; 0 / 239,616 ( 0 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 52 ( 0 % ) ;
; PLLs ; 0 / 4 ( 0 % ) ;
; Global clocks ; 1 / 16 ( 6 % ) ;
; JTAGs ; 0 / 1 ( 0 % ) ;
; ASMI blocks ; 0 / 1 ( 0 % ) ;
; CRC blocks ; 0 / 1 ( 0 % ) ;
; Average interconnect usage (total/H/V) ; 15% / 15% / 16% ;
; Peak interconnect usage (total/H/V) ; 31% / 31% / 31% ;
; Maximum fan-out node ; ClockDivider:inst1|clk25MHz_~clkctrl ;
; Maximum fan-out ; 1085 ;
; Highest non-global fan-out signal ; Arkanoid:inst|lpm_divide:Div2|lpm_divide_8so:auto_generated|abs_divider_lbg:divider|quotient[1]~0 ;
; Highest non-global fan-out ; 197 ;
; Total fan-out ; 24145 ;
; Average fan-out ; 2.92 ;
+---------------------------------------------+---------------------------------------------------------------------------------------------------+
* Register count does not include registers inside RAM blocks or DSP blocks.
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+-----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+-----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; button1 ; T21 ; 6 ; 50 ; 9 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; button2 ; T22 ; 6 ; 50 ; 9 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; button3 ; R21 ; 6 ; 50 ; 10 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; button4 ; R22 ; 6 ; 50 ; 10 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; clk_50MHz ; L1 ; 2 ; 0 ; 13 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
+-----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+----------------------+---------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ; Output Enable Source ; Output Enable Group ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+----------------------+---------------------+
; blue[0] ; A9 ; 3 ; 15 ; 27 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; blue[1] ; D11 ; 3 ; 22 ; 27 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; blue[2] ; A10 ; 3 ; 20 ; 27 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; blue[3] ; B10 ; 3 ; 20 ; 27 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; green[0] ; B8 ; 3 ; 13 ; 27 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; green[1] ; C10 ; 3 ; 18 ; 27 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; green[2] ; B9 ; 3 ; 15 ; 27 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; green[3] ; A8 ; 3 ; 13 ; 27 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; h_sync ; A11 ; 3 ; 22 ; 27 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex0[0] ; J2 ; 2 ; 0 ; 18 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex0[1] ; J1 ; 2 ; 0 ; 18 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex0[2] ; H2 ; 2 ; 0 ; 19 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex0[3] ; H1 ; 2 ; 0 ; 19 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex0[4] ; F2 ; 2 ; 0 ; 20 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex0[5] ; F1 ; 2 ; 0 ; 20 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex0[6] ; E2 ; 2 ; 0 ; 20 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex1[0] ; E1 ; 2 ; 0 ; 20 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex1[1] ; H6 ; 2 ; 0 ; 21 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex1[2] ; H5 ; 2 ; 0 ; 21 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex1[3] ; H4 ; 2 ; 0 ; 21 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex1[4] ; G3 ; 2 ; 0 ; 21 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex1[5] ; D2 ; 2 ; 0 ; 22 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex1[6] ; D1 ; 2 ; 0 ; 22 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex2[0] ; G5 ; 2 ; 0 ; 22 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex2[1] ; G6 ; 2 ; 0 ; 23 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex2[2] ; C2 ; 2 ; 0 ; 23 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex2[3] ; C1 ; 2 ; 0 ; 23 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex2[4] ; E3 ; 2 ; 0 ; 24 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex2[5] ; E4 ; 2 ; 0 ; 24 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex2[6] ; D3 ; 2 ; 0 ; 25 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex3[0] ; F4 ; 2 ; 0 ; 23 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex3[1] ; D5 ; 2 ; 0 ; 24 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex3[2] ; D6 ; 2 ; 0 ; 24 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex3[3] ; J4 ; 2 ; 0 ; 18 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex3[4] ; L8 ; 2 ; 0 ; 19 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex3[5] ; F3 ; 2 ; 0 ; 22 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; hex3[6] ; D4 ; 2 ; 0 ; 25 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; led[0] ; U22 ; 6 ; 50 ; 7 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; led[1] ; U21 ; 6 ; 50 ; 7 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; led[2] ; V22 ; 6 ; 50 ; 7 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; led[3] ; V21 ; 6 ; 50 ; 6 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; led[4] ; W22 ; 6 ; 50 ; 5 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; led[5] ; W21 ; 6 ; 50 ; 4 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; led[6] ; Y22 ; 6 ; 50 ; 6 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; led[7] ; Y21 ; 6 ; 50 ; 6 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; red[0] ; D9 ; 3 ; 13 ; 27 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; red[1] ; C9 ; 3 ; 9 ; 27 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; red[2] ; A7 ; 3 ; 11 ; 27 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; red[3] ; B7 ; 3 ; 11 ; 27 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; v_sync ; B11 ; 3 ; 22 ; 27 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+----------------------+---------------------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 0 / 41 ( 0 % ) ; 3.3V ; -- ;
; 2 ; 31 / 33 ( 94 % ) ; 3.3V ; -- ;
; 3 ; 14 / 43 ( 33 % ) ; 3.3V ; -- ;
; 4 ; 0 / 40 ( 0 % ) ; 3.3V ; -- ;
; 5 ; 0 / 39 ( 0 % ) ; 3.3V ; -- ;
; 6 ; 13 / 36 ( 36 % ) ; 3.3V ; -- ;
; 7 ; 0 / 40 ( 0 % ) ; 3.3V ; -- ;
; 8 ; 0 / 43 ( 0 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; A1 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; A2 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; A3 ; 325 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A4 ; 324 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A5 ; 322 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A6 ; 320 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A7 ; 306 ; 3 ; red[2] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; A8 ; 304 ; 3 ; green[3] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; A9 ; 298 ; 3 ; blue[0] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; A10 ; 293 ; 3 ; blue[2] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; A11 ; 287 ; 3 ; h_sync ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; A12 ; 283 ; 4 ; GND+ ; ; ; ; Column I/O ; ; -- ; -- ;
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; C3 ; 1 ; 2 ; ~nCSO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; On ;
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; D7 ; 311 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; D8 ; 309 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; D9 ; 302 ; 3 ; red[0] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; D10 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; D11 ; 289 ; 3 ; blue[1] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; D12 ; 284 ; 3 ; GND+ ; ; ; ; Column I/O ; ; -- ; -- ;
; D13 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; D14 ; 267 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; D15 ; 259 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; D16 ; 255 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; D17 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; D18 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; D19 ; 240 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; D20 ; 241 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; D21 ; 229 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; D22 ; 230 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; E1 ; 20 ; 2 ; hex1[0] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
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; E3 ; 6 ; 2 ; hex2[4] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; E4 ; 7 ; 2 ; hex2[5] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; E5 ; ; ; VCCD_PLL3 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
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; E7 ; 316 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; E8 ; 308 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; E9 ; 301 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; E10 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; E11 ; 288 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; E12 ; 285 ; 3 ; GND+ ; ; ; ; Column I/O ; ; -- ; -- ;
; E13 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; E14 ; 266 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; E15 ; 256 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; E16 ; ; ; GNDA_PLL2 ; gnd ; ; ; -- ; ; -- ; -- ;
; E17 ; ; ; GND_PLL2 ; gnd ; ; ; -- ; ; -- ; -- ;
; E18 ; 243 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; E19 ; 242 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; E20 ; 234 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; E21 ; 227 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; E22 ; 228 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; F1 ; 22 ; 2 ; hex0[5] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; F2 ; 23 ; 2 ; hex0[4] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; F3 ; 13 ; 2 ; hex3[5] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; F4 ; 10 ; 2 ; hex3[0] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; F5 ; ; ; GND_PLL3 ; gnd ; ; ; -- ; ; -- ; -- ;
; F6 ; ; ; GND_PLL3 ; gnd ; ; ; -- ; ; -- ; -- ;
; F7 ; ; ; GNDA_PLL3 ; gnd ; ; ; -- ; ; -- ; -- ;
; F8 ; 312 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; F9 ; 307 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; F10 ; 295 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; F11 ; 294 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; F12 ; 276 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
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; F14 ; 268 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
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; F20 ; 235 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; F21 ; 223 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; F22 ; 224 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; G1 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; G2 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; G3 ; 16 ; 2 ; hex1[4] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; G4 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
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; G6 ; 11 ; 2 ; hex2[1] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
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; G9 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; G10 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; G11 ; 291 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; G12 ; 277 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; G13 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; G14 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; G15 ; 261 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; G16 ; 252 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; G17 ; 231 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
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; G20 ; 233 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
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; H1 ; 24 ; 2 ; hex0[3] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
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; H5 ; 18 ; 2 ; hex1[2] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
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; H7 ; 318 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
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; H11 ; 290 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; H12 ; 274 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; H13 ; 263 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; H14 ; 257 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; H15 ; 253 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; H16 ; 219 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
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; H19 ; 214 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; H20 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; H21 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; H22 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; J1 ; 29 ; 2 ; hex0[1] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; J2 ; 30 ; 2 ; hex0[0] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; J3 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; J4 ; 28 ; 2 ; hex3[3] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; J5 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; J6 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; J7 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; J8 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; J9 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
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; J11 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; J12 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; J13 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; J14 ; 258 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; J15 ; 220 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; J16 ; ; 5 ; VCCIO5 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; J17 ; 218 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; J18 ; 217 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; J19 ; 216 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; J20 ; 213 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; J21 ; 211 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; J22 ; 212 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; K1 ; 37 ; 2 ; ^nCE ; ; ; ; -- ; ; -- ; -- ;
; K2 ; 32 ; 2 ; #TCK ; input ; ; ; -- ; ; -- ; -- ;
; K3 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; K4 ; 36 ; 2 ; ^DATA0 ; input ; ; ; -- ; ; -- ; -- ;
; K5 ; 31 ; 2 ; #TDI ; input ; ; ; -- ; ; -- ; -- ;
; K6 ; 33 ; 2 ; #TMS ; input ; ; ; -- ; ; -- ; -- ;
; K7 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; K8 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; K9 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; K10 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; K11 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; K12 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; K13 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; K14 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; K15 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; K16 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; K17 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; K18 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; K19 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; K20 ; 215 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; K21 ; 209 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; K22 ; 210 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; L1 ; 38 ; 2 ; clk_50MHz ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; L2 ; 39 ; 2 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; L3 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; L4 ; 40 ; 2 ; ^nCONFIG ; ; ; ; -- ; ; -- ; -- ;
; L5 ; 34 ; 2 ; #TDO ; output ; ; ; -- ; ; -- ; -- ;
; L6 ; 35 ; 2 ; ^DCLK ; ; ; ; -- ; ; -- ; -- ;
; L7 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; L8 ; 26 ; 2 ; hex3[4] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; L9 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; L10 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; L11 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; L12 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; L13 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; L14 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; L15 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; L16 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; L17 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; L18 ; 208 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; L19 ; 207 ; 5 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; L20 ; ; 5 ; VCCIO5 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; L21 ; 205 ; 5 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; L22 ; 206 ; 5 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; M1 ; 41 ; 1 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; M2 ; 42 ; 1 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; M3 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; M4 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; M5 ; 43 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; M6 ; 44 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; M7 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; M8 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; M9 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; M10 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; M11 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; M12 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; M13 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; M14 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; M15 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; M16 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; M17 ; 198 ; 6 ; ^MSEL0 ; ; ; ; -- ; ; -- ; -- ;
; M18 ; 202 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; M19 ; 201 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; M20 ; ; 6 ; VCCIO6 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; M21 ; 203 ; 6 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; M22 ; 204 ; 6 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; N1 ; 45 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; N2 ; 46 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; N3 ; 51 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; N4 ; 52 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; N5 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; N6 ; 49 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; N7 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; N8 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; N9 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; N10 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; N11 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; N12 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; N13 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; N14 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; N15 ; 194 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; N16 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; N17 ; 197 ; 6 ; ^MSEL1 ; ; ; ; -- ; ; -- ; -- ;
; N18 ; 196 ; 6 ; ^CONF_DONE ; ; ; ; -- ; ; -- ; -- ;
; N19 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; N20 ; 195 ; 6 ; ^nSTATUS ; ; ; ; -- ; ; -- ; -- ;
; N21 ; 199 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; N22 ; 200 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; P1 ; 47 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; P2 ; 48 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; P3 ; 50 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; P4 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; P5 ; 55 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; P6 ; 56 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; P7 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; P8 ; 95 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; P9 ; 94 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; P10 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; P11 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; P12 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; P13 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; P14 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; P15 ; 193 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; P16 ; ; 6 ; VCCIO6 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; P17 ; 186 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; P18 ; 187 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; P19 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; P20 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; P21 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; P22 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; R1 ; 57 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; R2 ; 58 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; R3 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; R4 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; R5 ; 63 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; R6 ; 64 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; R7 ; 54 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; R8 ; 53 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; R9 ; 109 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; R10 ; 108 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; R11 ; 116 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; R12 ; 134 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; R13 ; 145 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; R14 ; 150 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; R15 ; 151 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; R16 ; 155 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; R17 ; 177 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; R18 ; 184 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; R19 ; 185 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; R20 ; 192 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; R21 ; 190 ; 6 ; button3 ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; R22 ; 191 ; 6 ; button4 ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; T1 ; 59 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; T2 ; 60 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; T3 ; 69 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; T4 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; T5 ; 67 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; T6 ; 68 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; T7 ; 91 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T8 ; 90 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T9 ; ; 8 ; VCCIO8 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; T10 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; T11 ; 115 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T12 ; 131 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T13 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; T14 ; ; 7 ; VCCIO7 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; T15 ; 147 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T16 ; 156 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T17 ; ; ; GND_PLL4 ; gnd ; ; ; -- ; ; -- ; -- ;
; T18 ; 171 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; T19 ; ; 6 ; VCCIO6 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; T20 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; T21 ; 188 ; 6 ; button1 ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; T22 ; 189 ; 6 ; button2 ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; U1 ; 61 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; U2 ; 62 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; U3 ; 70 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; U4 ; 80 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; U5 ; ; ; GND_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; U6 ; ; ; VCCD_PLL1 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; U7 ; ; ; VCCA_PLL1 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; U8 ; 92 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; U9 ; 106 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; U10 ; 107 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; U11 ; 123 ; 8 ; GND+ ; ; ; ; Column I/O ; ; -- ; -- ;
; U12 ; 124 ; 8 ; GND+ ; ; ; ; Column I/O ; ; -- ; -- ;
; U13 ; 132 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; U14 ; 146 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; U15 ; 157 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; U16 ; ; ; VCCA_PLL4 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; U17 ; ; ; VCCD_PLL4 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; U18 ; 170 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; U19 ; 172 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; U20 ; 176 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; U21 ; 182 ; 6 ; led[1] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; U22 ; 183 ; 6 ; led[0] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; V1 ; 65 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; V2 ; 66 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; V3 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; V4 ; 81 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; V5 ; ; ; GND_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; V6 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; V7 ; ; ; GNDA_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; V8 ; 98 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; V9 ; 101 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; V10 ; ; 8 ; VCCIO8 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; V11 ; 118 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; V12 ; 126 ; 7 ; GND+ ; ; ; ; Column I/O ; ; -- ; -- ;
; V13 ; ; 7 ; VCCIO7 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; V14 ; 142 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; V15 ; 158 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; V16 ; ; ; GNDA_PLL4 ; gnd ; ; ; -- ; ; -- ; -- ;
; V17 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; V18 ; ; ; GND_PLL4 ; gnd ; ; ; -- ; ; -- ; -- ;
; V19 ; 166 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; V20 ; 173 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; V21 ; 180 ; 6 ; led[3] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; V22 ; 181 ; 6 ; led[2] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; W1 ; 71 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; W2 ; 72 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; W3 ; 75 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; W4 ; 76 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; W5 ; 79 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; W6 ; ; 8 ; VCCIO8 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; W7 ; 99 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W8 ; 100 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W9 ; 105 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W10 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; W11 ; 117 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W12 ; 125 ; 7 ; GND+ ; ; ; ; Column I/O ; ; -- ; -- ;
; W13 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; W14 ; 141 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W15 ; 149 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W16 ; 160 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W17 ; ; 7 ; VCCIO7 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; W18 ; ; ; NC ; ; ; ; -- ; ; -- ; -- ;
; W19 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; W20 ; 167 ; 6 ; ~LVDS91p/nCEO~ ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; W21 ; 174 ; 6 ; led[5] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; W22 ; 175 ; 6 ; led[4] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; Y1 ; 73 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; Y2 ; 74 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; Y3 ; 77 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; Y4 ; 78 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; Y5 ; 86 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y6 ; 87 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y7 ; 93 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y8 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; Y9 ; 104 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y10 ; 112 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y11 ; ; 8 ; VCCIO8 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; Y12 ; ; 7 ; VCCIO7 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; Y13 ; 133 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y14 ; 148 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y15 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; Y16 ; 154 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y17 ; 159 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y18 ; 165 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; Y19 ; 168 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; Y20 ; 169 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; Y21 ; 178 ; 6 ; led[7] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; Y22 ; 179 ; 6 ; led[6] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
Note: Pin directions (input, output or bidir) are based on device operating in user mode.
+-------------------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+----------------------------------+-------+------------------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+----------------------------------+-------+------------------------------------+
; 3.3-V LVTTL ; 0 pF ; Not Available ;
; 3.3-V LVCMOS ; 0 pF ; Not Available ;
; 2.5 V ; 0 pF ; Not Available ;
; 1.8 V ; 0 pF ; Not Available ;
; 1.5 V ; 0 pF ; Not Available ;
; 3.3-V PCI ; 10 pF ; 25 Ohm (Parallel) ;
; 3.3-V PCI-X ; 10 pF ; 25 Ohm (Parallel) ;
; SSTL-2 Class I ; 0 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II ; 0 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-18 Class I ; 0 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-18 Class II ; 0 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; 1.5-V HSTL Class I ; 0 pF ; 50 Ohm (Parallel) ;
; 1.5-V HSTL Class II ; 0 pF ; 25 Ohm (Parallel) ;
; 1.8-V HSTL Class I ; 0 pF ; 50 Ohm (Parallel) ;
; 1.8-V HSTL Class II ; 0 pF ; 25 Ohm (Parallel) ;
; Differential SSTL-2 ; 0 pF ; (See SSTL-2) ;
; Differential 2.5-V SSTL Class II ; 0 pF ; (See SSTL-2 Class II) ;
; Differential 1.8-V SSTL Class I ; 0 pF ; (See 1.8-V SSTL Class I) ;
; Differential 1.8-V SSTL Class II ; 0 pF ; (See 1.8-V SSTL Class II) ;
; Differential 1.5-V HSTL Class I ; 0 pF ; (See 1.5-V HSTL Class I) ;
; Differential 1.5-V HSTL Class II ; 0 pF ; (See 1.5-V HSTL Class II) ;
; Differential 1.8-V HSTL Class I ; 0 pF ; (See 1.8-V HSTL Class I) ;
; Differential 1.8-V HSTL Class II ; 0 pF ; (See 1.8-V HSTL Class II) ;
; LVDS ; 0 pF ; 100 Ohm (Differential) ;
; mini-LVDS ; 0 pF ; 100 Ohm (Differential) ;
; RSDS ; 0 pF ; 100 Ohm (Differential) ;
; Simple RSDS ; 0 pF ; Not Available ;
; Differential LVPECL ; 0 pF ; 100 Ohm (Differential) ;
+----------------------------------+-------+------------------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+------------------------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+-------------------------------------------------------------------------------------------------------------------------+--------------+
; Compilation Hierarchy Node ; Logic Cells ; Dedicated Logic Registers ; I/O Registers ; Memory Bits ; M4Ks ; DSP Elements ; DSP 9x9 ; DSP 18x18 ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Full Hierarchy Name ; Library Name ;
+------------------------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+-------------------------------------------------------------------------------------------------------------------------+--------------+
; |TotalScheme ; 7148 (0) ; 1086 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 55 ; 0 ; 6062 (0) ; 52 (0) ; 1034 (0) ; |TotalScheme ; work ;
; |Arkanoid:inst| ; 7110 (3971) ; 1049 (1049) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 6059 (2920) ; 31 (31) ; 1020 (1020) ; |TotalScheme|Arkanoid:inst ; ;
; |lpm_divide:Div0| ; 515 (0) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 515 (0) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div0 ; ;
; |lpm_divide_7so:auto_generated| ; 515 (0) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 515 (0) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated ; ;
; |abs_divider_kbg:divider| ; 515 (35) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 515 (35) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider ; ;
; |alt_u_div_k2f:divider| ; 449 (449) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 449 (449) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider ; ;
; |lpm_abs_0s9:my_abs_num| ; 31 (31) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 31 (31) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|lpm_abs_0s9:my_abs_num ; ;
; |lpm_divide:Div1| ; 515 (0) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 515 (0) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div1 ; ;
; |lpm_divide_7so:auto_generated| ; 515 (0) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 515 (0) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div1|lpm_divide_7so:auto_generated ; ;
; |abs_divider_kbg:divider| ; 515 (35) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 515 (35) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div1|lpm_divide_7so:auto_generated|abs_divider_kbg:divider ; ;
; |alt_u_div_k2f:divider| ; 449 (449) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 449 (449) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div1|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider ; ;
; |lpm_abs_0s9:my_abs_num| ; 31 (31) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 31 (31) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div1|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|lpm_abs_0s9:my_abs_num ; ;
; |lpm_divide:Div2| ; 553 (0) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 553 (0) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div2 ; ;
; |lpm_divide_8so:auto_generated| ; 553 (0) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 553 (0) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div2|lpm_divide_8so:auto_generated ; ;
; |abs_divider_lbg:divider| ; 553 (10) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 553 (10) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div2|lpm_divide_8so:auto_generated|abs_divider_lbg:divider ; ;
; |alt_u_div_m2f:divider| ; 511 (511) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 511 (511) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div2|lpm_divide_8so:auto_generated|abs_divider_lbg:divider|alt_u_div_m2f:divider ; ;
; |lpm_abs_0s9:my_abs_num| ; 32 (32) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 32 (32) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div2|lpm_divide_8so:auto_generated|abs_divider_lbg:divider|lpm_abs_0s9:my_abs_num ; ;
; |lpm_divide:Div3| ; 553 (0) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 553 (0) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div3 ; ;
; |lpm_divide_8so:auto_generated| ; 553 (0) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 553 (0) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div3|lpm_divide_8so:auto_generated ; ;
; |abs_divider_lbg:divider| ; 553 (10) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 553 (10) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div3|lpm_divide_8so:auto_generated|abs_divider_lbg:divider ; ;
; |alt_u_div_m2f:divider| ; 511 (511) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 511 (511) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div3|lpm_divide_8so:auto_generated|abs_divider_lbg:divider|alt_u_div_m2f:divider ; ;
; |lpm_abs_0s9:my_abs_num| ; 32 (32) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 32 (32) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Div3|lpm_divide_8so:auto_generated|abs_divider_lbg:divider|lpm_abs_0s9:my_abs_num ; ;
; |lpm_divide:Mod0| ; 502 (0) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 502 (0) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Mod0 ; ;
; |lpm_divide_ako:auto_generated| ; 502 (0) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 502 (0) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Mod0|lpm_divide_ako:auto_generated ; ;
; |abs_divider_kbg:divider| ; 502 (10) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 502 (10) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Mod0|lpm_divide_ako:auto_generated|abs_divider_kbg:divider ; ;
; |alt_u_div_k2f:divider| ; 459 (459) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 459 (459) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Mod0|lpm_divide_ako:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider ; ;
; |lpm_abs_0s9:my_abs_num| ; 33 (33) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 33 (33) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Mod0|lpm_divide_ako:auto_generated|abs_divider_kbg:divider|lpm_abs_0s9:my_abs_num ; ;
; |lpm_divide:Mod1| ; 501 (0) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 501 (0) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Mod1 ; ;
; |lpm_divide_ako:auto_generated| ; 501 (0) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 501 (0) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Mod1|lpm_divide_ako:auto_generated ; ;
; |abs_divider_kbg:divider| ; 501 (9) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 501 (9) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Mod1|lpm_divide_ako:auto_generated|abs_divider_kbg:divider ; ;
; |alt_u_div_k2f:divider| ; 459 (459) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 459 (459) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Mod1|lpm_divide_ako:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider ; ;
; |lpm_abs_0s9:my_abs_num| ; 33 (33) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 33 (33) ; 0 (0) ; 0 (0) ; |TotalScheme|Arkanoid:inst|lpm_divide:Mod1|lpm_divide_ako:auto_generated|abs_divider_kbg:divider|lpm_abs_0s9:my_abs_num ; ;
; |ClockDivider:inst1| ; 1 (1) ; 1 (1) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 1 (1) ; |TotalScheme|ClockDivider:inst1 ; ;
; |Debouncer:inst2| ; 9 (9) ; 9 (9) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 5 (5) ; 4 (4) ; |TotalScheme|Debouncer:inst2 ; ;
; |Debouncer:inst3| ; 10 (10) ; 9 (9) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 6 (6) ; 3 (3) ; |TotalScheme|Debouncer:inst3 ; ;
; |Debouncer:inst4| ; 10 (10) ; 9 (9) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 5 (5) ; 4 (4) ; |TotalScheme|Debouncer:inst4 ; ;
; |Debouncer:inst5| ; 10 (10) ; 9 (9) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 5 (5) ; 4 (4) ; |TotalScheme|Debouncer:inst5 ; ;
+------------------------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+-------------------------------------------------------------------------------------------------------------------------+--------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
+------------------------------------------------------------------------------------+
; Delay Chain Summary ;
+-----------+----------+---------------+---------------+-----------------------+-----+
; Name ; Pin Type ; Pad to Core 0 ; Pad to Core 1 ; Pad to Input Register ; TCO ;
+-----------+----------+---------------+---------------+-----------------------+-----+
; h_sync ; Output ; -- ; -- ; -- ; -- ;
; v_sync ; Output ; -- ; -- ; -- ; -- ;
; blue[3] ; Output ; -- ; -- ; -- ; -- ;
; blue[2] ; Output ; -- ; -- ; -- ; -- ;
; blue[1] ; Output ; -- ; -- ; -- ; -- ;
; blue[0] ; Output ; -- ; -- ; -- ; -- ;
; green[3] ; Output ; -- ; -- ; -- ; -- ;
; green[2] ; Output ; -- ; -- ; -- ; -- ;
; green[1] ; Output ; -- ; -- ; -- ; -- ;
; green[0] ; Output ; -- ; -- ; -- ; -- ;
; hex0[6] ; Output ; -- ; -- ; -- ; -- ;
; hex0[5] ; Output ; -- ; -- ; -- ; -- ;
; hex0[4] ; Output ; -- ; -- ; -- ; -- ;
; hex0[3] ; Output ; -- ; -- ; -- ; -- ;
; hex0[2] ; Output ; -- ; -- ; -- ; -- ;
; hex0[1] ; Output ; -- ; -- ; -- ; -- ;
; hex0[0] ; Output ; -- ; -- ; -- ; -- ;
; hex1[6] ; Output ; -- ; -- ; -- ; -- ;
; hex1[5] ; Output ; -- ; -- ; -- ; -- ;
; hex1[4] ; Output ; -- ; -- ; -- ; -- ;
; hex1[3] ; Output ; -- ; -- ; -- ; -- ;
; hex1[2] ; Output ; -- ; -- ; -- ; -- ;
; hex1[1] ; Output ; -- ; -- ; -- ; -- ;
; hex1[0] ; Output ; -- ; -- ; -- ; -- ;
; hex2[6] ; Output ; -- ; -- ; -- ; -- ;
; hex2[5] ; Output ; -- ; -- ; -- ; -- ;
; hex2[4] ; Output ; -- ; -- ; -- ; -- ;
; hex2[3] ; Output ; -- ; -- ; -- ; -- ;
; hex2[2] ; Output ; -- ; -- ; -- ; -- ;
; hex2[1] ; Output ; -- ; -- ; -- ; -- ;
; hex2[0] ; Output ; -- ; -- ; -- ; -- ;
; hex3[6] ; Output ; -- ; -- ; -- ; -- ;
; hex3[5] ; Output ; -- ; -- ; -- ; -- ;
; hex3[4] ; Output ; -- ; -- ; -- ; -- ;
; hex3[3] ; Output ; -- ; -- ; -- ; -- ;
; hex3[2] ; Output ; -- ; -- ; -- ; -- ;
; hex3[1] ; Output ; -- ; -- ; -- ; -- ;
; hex3[0] ; Output ; -- ; -- ; -- ; -- ;
; led[7] ; Output ; -- ; -- ; -- ; -- ;
; led[6] ; Output ; -- ; -- ; -- ; -- ;
; led[5] ; Output ; -- ; -- ; -- ; -- ;
; led[4] ; Output ; -- ; -- ; -- ; -- ;
; led[3] ; Output ; -- ; -- ; -- ; -- ;
; led[2] ; Output ; -- ; -- ; -- ; -- ;
; led[1] ; Output ; -- ; -- ; -- ; -- ;
; led[0] ; Output ; -- ; -- ; -- ; -- ;
; red[3] ; Output ; -- ; -- ; -- ; -- ;
; red[2] ; Output ; -- ; -- ; -- ; -- ;
; red[1] ; Output ; -- ; -- ; -- ; -- ;
; red[0] ; Output ; -- ; -- ; -- ; -- ;
; clk_50MHz ; Input ; (0) 325 ps ; (0) 325 ps ; -- ; -- ;
; button1 ; Input ; (6) 4358 ps ; (6) 4358 ps ; -- ; -- ;
; button2 ; Input ; (6) 4358 ps ; (6) 4358 ps ; -- ; -- ;
; button3 ; Input ; (6) 4358 ps ; (6) 4358 ps ; -- ; -- ;
; button4 ; Input ; (6) 4358 ps ; (6) 4358 ps ; -- ; -- ;
+-----------+----------+---------------+---------------+-----------------------+-----+
+--------------------------------------------------------------------+
; Pad To Core Delay Chain Fanout ;
+--------------------------------------+-------------------+---------+
; Source Pin / Fanout ; Pad To Core Index ; Setting ;
+--------------------------------------+-------------------+---------+
; clk_50MHz ; ; ;
; button1 ; ; ;
; - Debouncer:inst2|button_reg[0] ; 0 ; 6 ;
; button2 ; ; ;
; - Debouncer:inst3|button_reg[0] ; 0 ; 6 ;
; button3 ; ; ;
; - Debouncer:inst4|button_reg[0] ; 0 ; 6 ;
; button4 ; ; ;
; - Debouncer:inst5|button_reg[0] ; 1 ; 6 ;
+--------------------------------------+-------------------+---------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Control Signals ;
+------------------------------+--------------------+---------+---------------------------+--------+----------------------+------------------+---------------------------+
; Name ; Location ; Fan-Out ; Usage ; Global ; Global Resource Used ; Global Line Name ; Enable Signal Source Name ;
+------------------------------+--------------------+---------+---------------------------+--------+----------------------+------------------+---------------------------+
; Arkanoid:inst|Equal1~10 ; LCCOMB_X21_Y13_N0 ; 32 ; Sync. clear ; no ; -- ; -- ; -- ;
; Arkanoid:inst|LessThan132~10 ; LCCOMB_X32_Y19_N22 ; 36 ; Sync. clear ; no ; -- ; -- ; -- ;
; Arkanoid:inst|always2~10 ; LCCOMB_X32_Y11_N6 ; 3 ; Clock enable ; no ; -- ; -- ; -- ;
; Arkanoid:inst|always2~11 ; LCCOMB_X32_Y10_N30 ; 3 ; Clock enable ; no ; -- ; -- ; -- ;
; Arkanoid:inst|always2~12 ; LCCOMB_X31_Y13_N18 ; 3 ; Clock enable ; no ; -- ; -- ; -- ;
; Arkanoid:inst|always2~9 ; LCCOMB_X33_Y13_N30 ; 3 ; Clock enable ; no ; -- ; -- ; -- ;
; Arkanoid:inst|game_state~4 ; LCCOMB_X31_Y13_N4 ; 37 ; Clock enable, Sync. clear ; no ; -- ; -- ; -- ;
; ClockDivider:inst1|clk25MHz_ ; LCFF_X1_Y13_N29 ; 1085 ; Clock ; yes ; Global Clock ; GCLK0 ; -- ;
; clk_50MHz ; PIN_L1 ; 1 ; Clock ; no ; -- ; -- ; -- ;
+------------------------------+--------------------+---------+---------------------------+--------+----------------------+------------------+---------------------------+
+--------------------------------------------------------------------------------------------------------------------------------+
; Global & Other Fast Signals ;
+------------------------------+-----------------+---------+----------------------+------------------+---------------------------+
; Name ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ; Enable Signal Source Name ;
+------------------------------+-----------------+---------+----------------------+------------------+---------------------------+
; ClockDivider:inst1|clk25MHz_ ; LCFF_X1_Y13_N29 ; 1085 ; Global Clock ; GCLK0 ; -- ;
+------------------------------+-----------------+---------+----------------------+------------------+---------------------------+
+-------------------------------------------------------------------------------------------------------------+
; Non-Global High Fan-Out Signals ;
+---------------------------------------------------------------------------------------------------+---------+
; Name ; Fan-Out ;
+---------------------------------------------------------------------------------------------------+---------+
; Arkanoid:inst|lpm_divide:Div2|lpm_divide_8so:auto_generated|abs_divider_lbg:divider|quotient[3]~3 ; 197 ;
; Arkanoid:inst|lpm_divide:Div2|lpm_divide_8so:auto_generated|abs_divider_lbg:divider|quotient[2]~2 ; 197 ;
; Arkanoid:inst|lpm_divide:Div2|lpm_divide_8so:auto_generated|abs_divider_lbg:divider|quotient[0]~1 ; 197 ;
; Arkanoid:inst|lpm_divide:Div2|lpm_divide_8so:auto_generated|abs_divider_lbg:divider|quotient[1]~0 ; 197 ;
; Arkanoid:inst|ball_direction~17 ; 142 ;
; Arkanoid:inst|Decoder3~1 ; 131 ;
; Arkanoid:inst|Decoder2~12 ; 129 ;
; Arkanoid:inst|Decoder3~33 ; 124 ;
; Arkanoid:inst|Decoder2~13 ; 122 ;
; Arkanoid:inst|game_state ; 110 ;
; Arkanoid:inst|Decoder2~8 ; 100 ;
; Arkanoid:inst|field~885 ; 96 ;
; Arkanoid:inst|field~1017 ; 94 ;
; Arkanoid:inst|Add14~65 ; 93 ;
; Arkanoid:inst|field~819 ; 92 ;
; Arkanoid:inst|Add9~65 ; 89 ;
; Arkanoid:inst|Selector37~3 ; 83 ;
; Arkanoid:inst|platform1_position~61 ; 79 ;
; Arkanoid:inst|platform2_position~4 ; 73 ;
; Arkanoid:inst|Decoder2~11 ; 72 ;
; Arkanoid:inst|platform1_position~60 ; 69 ;
; Arkanoid:inst|field~1451 ; 65 ;
; Arkanoid:inst|field~951 ; 64 ;
; Arkanoid:inst|platform1_position~75 ; 56 ;
; Arkanoid:inst|ball_y~25 ; 55 ;
; Arkanoid:inst|LessThan137~0 ; 43 ;
; Arkanoid:inst|ball_x~28 ; 43 ;
; Debouncer:inst3|debounced ; 42 ;
; Arkanoid:inst|Decoder2~14 ; 41 ;
; Arkanoid:inst|player2_score~2 ; 37 ;
; Arkanoid:inst|game_state~4 ; 37 ;
; Arkanoid:inst|player1_score~1 ; 36 ;
; Arkanoid:inst|LessThan132~10 ; 36 ;
; Arkanoid:inst|Decoder2~9 ; 36 ;
; Arkanoid:inst|button2_state ; 36 ;
; Arkanoid:inst|Add15~60 ; 36 ;
; Arkanoid:inst|Add16~60 ; 36 ;
; Arkanoid:inst|ball_y~27 ; 35 ;
; Arkanoid:inst|platform2_position~84 ; 35 ;
; Arkanoid:inst|field~710 ; 34 ;
; Arkanoid:inst|game_state~3 ; 34 ;
; Arkanoid:inst|platform1_position~76 ; 33 ;
; Arkanoid:inst|Add13~62 ; 33 ;
; Arkanoid:inst|Add7~62 ; 33 ;
; Arkanoid:inst|field~1820 ; 32 ;
; Arkanoid:inst|field~1755 ; 32 ;
; Arkanoid:inst|field~1658 ; 32 ;
; Arkanoid:inst|field~1656 ; 32 ;
; Arkanoid:inst|field~1591 ; 32 ;
; Arkanoid:inst|field~1551 ; 32 ;
+---------------------------------------------------------------------------------------------------+---------+
+------------------------------------------------------+
; Interconnect Usage Summary ;
+----------------------------+-------------------------+
; Interconnect Resource Type ; Usage ;
+----------------------------+-------------------------+
; Block interconnects ; 9,680 / 54,004 ( 18 % ) ;
; C16 interconnects ; 106 / 2,100 ( 5 % ) ;
; C4 interconnects ; 5,746 / 36,000 ( 16 % ) ;
; Direct links ; 2,159 / 54,004 ( 4 % ) ;
; Global clocks ; 1 / 16 ( 6 % ) ;
; Local interconnects ; 3,489 / 18,752 ( 19 % ) ;
; R24 interconnects ; 197 / 1,900 ( 10 % ) ;
; R4 interconnects ; 6,847 / 46,920 ( 15 % ) ;
+----------------------------+-------------------------+
+-----------------------------------------------------------------------------+
; LAB Logic Elements ;
+---------------------------------------------+-------------------------------+
; Number of Logic Elements (Average = 13.72) ; Number of LABs (Total = 521) ;
+---------------------------------------------+-------------------------------+
; 1 ; 22 ;
; 2 ; 16 ;
; 3 ; 32 ;
; 4 ; 7 ;
; 5 ; 1 ;
; 6 ; 4 ;
; 7 ; 2 ;
; 8 ; 1 ;
; 9 ; 3 ;
; 10 ; 0 ;
; 11 ; 3 ;
; 12 ; 1 ;
; 13 ; 0 ;
; 14 ; 7 ;
; 15 ; 3 ;
; 16 ; 419 ;
+---------------------------------------------+-------------------------------+
+--------------------------------------------------------------------+
; LAB-wide Signals ;
+------------------------------------+-------------------------------+
; LAB-wide Signals (Average = 0.38) ; Number of LABs (Total = 521) ;
+------------------------------------+-------------------------------+
; 1 Clock ; 189 ;
; 1 Clock enable ; 5 ;
; 1 Sync. clear ; 4 ;
+------------------------------------+-------------------------------+
+------------------------------------------------------------------------------+
; LAB Signals Sourced ;
+----------------------------------------------+-------------------------------+
; Number of Signals Sourced (Average = 15.18) ; Number of LABs (Total = 521) ;
+----------------------------------------------+-------------------------------+
; 0 ; 4 ;
; 1 ; 24 ;
; 2 ; 17 ;
; 3 ; 31 ;
; 4 ; 7 ;
; 5 ; 1 ;
; 6 ; 3 ;
; 7 ; 4 ;
; 8 ; 1 ;
; 9 ; 0 ;
; 10 ; 1 ;
; 11 ; 5 ;
; 12 ; 1 ;
; 13 ; 1 ;
; 14 ; 43 ;
; 15 ; 91 ;
; 16 ; 110 ;
; 17 ; 19 ;
; 18 ; 10 ;
; 19 ; 14 ;
; 20 ; 16 ;
; 21 ; 10 ;
; 22 ; 61 ;
; 23 ; 13 ;
; 24 ; 10 ;
; 25 ; 3 ;
; 26 ; 3 ;
; 27 ; 6 ;
; 28 ; 2 ;
; 29 ; 4 ;
; 30 ; 2 ;
; 31 ; 0 ;
; 32 ; 4 ;
+----------------------------------------------+-------------------------------+
+---------------------------------------------------------------------------------+
; LAB Signals Sourced Out ;
+-------------------------------------------------+-------------------------------+
; Number of Signals Sourced Out (Average = 8.48) ; Number of LABs (Total = 521) ;
+-------------------------------------------------+-------------------------------+
; 0 ; 4 ;
; 1 ; 74 ;
; 2 ; 79 ;
; 3 ; 12 ;
; 4 ; 8 ;
; 5 ; 5 ;
; 6 ; 14 ;
; 7 ; 4 ;
; 8 ; 17 ;
; 9 ; 53 ;
; 10 ; 47 ;
; 11 ; 52 ;
; 12 ; 19 ;
; 13 ; 31 ;
; 14 ; 17 ;
; 15 ; 5 ;
; 16 ; 65 ;
; 17 ; 4 ;
; 18 ; 1 ;
; 19 ; 0 ;
; 20 ; 1 ;
; 21 ; 1 ;
; 22 ; 0 ;
; 23 ; 1 ;
; 24 ; 1 ;
; 25 ; 0 ;
; 26 ; 0 ;
; 27 ; 2 ;
; 28 ; 1 ;
; 29 ; 2 ;
; 30 ; 1 ;
+-------------------------------------------------+-------------------------------+
+------------------------------------------------------------------------------+
; LAB Distinct Inputs ;
+----------------------------------------------+-------------------------------+
; Number of Distinct Inputs (Average = 16.41) ; Number of LABs (Total = 521) ;
+----------------------------------------------+-------------------------------+
; 0 ; 0 ;
; 1 ; 1 ;
; 2 ; 40 ;
; 3 ; 20 ;
; 4 ; 16 ;
; 5 ; 7 ;
; 6 ; 2 ;
; 7 ; 8 ;
; 8 ; 1 ;
; 9 ; 4 ;
; 10 ; 1 ;
; 11 ; 23 ;
; 12 ; 12 ;
; 13 ; 27 ;
; 14 ; 41 ;
; 15 ; 21 ;
; 16 ; 25 ;
; 17 ; 28 ;
; 18 ; 24 ;
; 19 ; 14 ;
; 20 ; 42 ;
; 21 ; 6 ;
; 22 ; 56 ;
; 23 ; 13 ;
; 24 ; 9 ;
; 25 ; 14 ;
; 26 ; 7 ;
; 27 ; 11 ;
; 28 ; 9 ;
; 29 ; 8 ;
; 30 ; 20 ;
; 31 ; 3 ;
; 32 ; 4 ;
; 33 ; 4 ;
+----------------------------------------------+-------------------------------+
+-------------------------------------------------------------------------+
; Fitter Device Options ;
+----------------------------------------------+--------------------------+
; Option ; Setting ;
+----------------------------------------------+--------------------------+
; Enable user-supplied start-up clock (CLKUSR) ; Off ;
; Enable device-wide reset (DEV_CLRn) ; Off ;
; Enable device-wide output enable (DEV_OE) ; Off ;
; Enable INIT_DONE output ; Off ;
; Configuration scheme ; Active Serial ;
; Error detection CRC ; Off ;
; nCEO ; As output driving ground ;
; ASDO,nCSO ; As input tri-stated ;
; Reserve all unused pins ; As output driving ground ;
; Base pin-out file on sameframe device ; Off ;
+----------------------------------------------+--------------------------+
+------------------------------------+
; Operating Settings and Conditions ;
+---------------------------+--------+
; Setting ; Value ;
+---------------------------+--------+
; Nominal Core Voltage ; 1.20 V ;
; Low Junction Temperature ; 0 <20>C ;
; High Junction Temperature ; 85 <20>C ;
+---------------------------+--------+
+------------------------------------------------------------+
; Estimated Delay Added for Hold Timing ;
+-----------------+----------------------+-------------------+
; Source Clock(s) ; Destination Clock(s) ; Delay Added in ns ;
+-----------------+----------------------+-------------------+
+-----------------+
; Fitter Messages ;
+-----------------+
Info: *******************************************************************
Info: Running Quartus II Fitter
Info: Version 9.1 Build 222 10/21/2009 SJ Full Version
Info: Processing started: Mon May 28 14:21:59 2012
Info: Command: quartus_fit --read_settings_files=off --write_settings_files=off myArkanoid -c myArkanoid
Info: Parallel compilation is enabled and will use 2 of the 2 processors detected
Info: Selected device EP2C20F484C7 for design "myArkanoid"
Info: Low junction temperature is 0 degrees C
Info: High junction temperature is 85 degrees C
Info: Fitter is performing an Auto Fit compilation, which may decrease Fitter effort to reduce compilation time
Info: Device migration not selected. If you intend to use device migration later, you may need to change the pin assignments as they may be incompatible with other devices
Info: Device EP2C15AF484C7 is compatible
Info: Device EP2C35F484C7 is compatible
Info: Device EP2C50F484C7 is compatible
Info: Fitter converted 3 user pins into dedicated programming pins
Info: Pin ~ASDO~ is reserved at location C4
Info: Pin ~nCSO~ is reserved at location C3
Info: Pin ~LVDS91p/nCEO~ is reserved at location W20
Info: Timing-driven compilation is using the Classic Timing Analyzer
Info: Timing requirements not specified -- quality metrics such as performance and power consumption may be sacrificed to reduce compilation time.
Info: Automatically promoted node ClockDivider:inst1|clk25MHz_
Info: Automatically promoted destinations to use location or clock signal Global Clock
Info: Following destination nodes may be non-global or may not use global or regional clocks
Info: Destination node ClockDivider:inst1|clk25MHz_~0
Info: Starting register packing
Info: Finished register packing
Extra Info: No registers were packed into other blocks
Info: Fitter preparation operations ending: elapsed time is 00:00:03
Info: Fitter placement preparation operations beginning
Info: Fitter placement preparation operations ending: elapsed time is 00:00:01
Info: Fitter placement operations beginning
Info: Fitter placement was successful
Info: Fitter placement operations ending: elapsed time is 00:00:03
Info: Estimated most critical path is register to register delay of 139.129 ns
Info: 1: + IC(0.000 ns) + CELL(0.000 ns) = 0.000 ns; Loc. = LAB_X32_Y11; Fanout = 36; REG Node = 'Arkanoid:inst|button2_state'
Info: 2: + IC(0.779 ns) + CELL(0.544 ns) = 1.323 ns; Loc. = LAB_X33_Y13; Fanout = 73; COMB Node = 'Arkanoid:inst|platform2_position~4'
Info: 3: + IC(0.740 ns) + CELL(0.521 ns) = 2.584 ns; Loc. = LAB_X33_Y15; Fanout = 63; COMB Node = 'Arkanoid:inst|platform2_position~5'
Info: 4: + IC(1.073 ns) + CELL(0.495 ns) = 4.152 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~1'
Info: 5: + IC(0.000 ns) + CELL(0.080 ns) = 4.232 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~3'
Info: 6: + IC(0.000 ns) + CELL(0.080 ns) = 4.312 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~5'
Info: 7: + IC(0.000 ns) + CELL(0.080 ns) = 4.392 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~7'
Info: 8: + IC(0.000 ns) + CELL(0.080 ns) = 4.472 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~9'
Info: 9: + IC(0.000 ns) + CELL(0.080 ns) = 4.552 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~11'
Info: 10: + IC(0.000 ns) + CELL(0.080 ns) = 4.632 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~13'
Info: 11: + IC(0.000 ns) + CELL(0.080 ns) = 4.712 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~15'
Info: 12: + IC(0.000 ns) + CELL(0.080 ns) = 4.792 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~17'
Info: 13: + IC(0.000 ns) + CELL(0.080 ns) = 4.872 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~19'
Info: 14: + IC(0.000 ns) + CELL(0.080 ns) = 4.952 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~21'
Info: 15: + IC(0.000 ns) + CELL(0.080 ns) = 5.032 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~23'
Info: 16: + IC(0.000 ns) + CELL(0.080 ns) = 5.112 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~25'
Info: 17: + IC(0.000 ns) + CELL(0.080 ns) = 5.192 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~27'
Info: 18: + IC(0.000 ns) + CELL(0.080 ns) = 5.272 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~29'
Info: 19: + IC(0.000 ns) + CELL(0.080 ns) = 5.352 ns; Loc. = LAB_X32_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~31'
Info: 20: + IC(0.098 ns) + CELL(0.080 ns) = 5.530 ns; Loc. = LAB_X32_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~33'
Info: 21: + IC(0.000 ns) + CELL(0.080 ns) = 5.610 ns; Loc. = LAB_X32_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~35'
Info: 22: + IC(0.000 ns) + CELL(0.080 ns) = 5.690 ns; Loc. = LAB_X32_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~37'
Info: 23: + IC(0.000 ns) + CELL(0.080 ns) = 5.770 ns; Loc. = LAB_X32_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~39'
Info: 24: + IC(0.000 ns) + CELL(0.080 ns) = 5.850 ns; Loc. = LAB_X32_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~41'
Info: 25: + IC(0.000 ns) + CELL(0.080 ns) = 5.930 ns; Loc. = LAB_X32_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~43'
Info: 26: + IC(0.000 ns) + CELL(0.080 ns) = 6.010 ns; Loc. = LAB_X32_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~45'
Info: 27: + IC(0.000 ns) + CELL(0.080 ns) = 6.090 ns; Loc. = LAB_X32_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~47'
Info: 28: + IC(0.000 ns) + CELL(0.080 ns) = 6.170 ns; Loc. = LAB_X32_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~49'
Info: 29: + IC(0.000 ns) + CELL(0.080 ns) = 6.250 ns; Loc. = LAB_X32_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~51'
Info: 30: + IC(0.000 ns) + CELL(0.080 ns) = 6.330 ns; Loc. = LAB_X32_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|Add4~53'
Info: 31: + IC(0.000 ns) + CELL(0.458 ns) = 6.788 ns; Loc. = LAB_X32_Y15; Fanout = 1; COMB Node = 'Arkanoid:inst|Add4~54'
Info: 32: + IC(0.388 ns) + CELL(0.521 ns) = 7.697 ns; Loc. = LAB_X33_Y15; Fanout = 4; COMB Node = 'Arkanoid:inst|platform2_position~29'
Info: 33: + IC(0.498 ns) + CELL(0.177 ns) = 8.372 ns; Loc. = LAB_X33_Y15; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan3~3'
Info: 34: + IC(0.498 ns) + CELL(0.178 ns) = 9.048 ns; Loc. = LAB_X33_Y15; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan3~4'
Info: 35: + IC(1.237 ns) + CELL(0.322 ns) = 10.607 ns; Loc. = LAB_X31_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|LessThan3~10'
Info: 36: + IC(0.732 ns) + CELL(0.495 ns) = 11.834 ns; Loc. = LAB_X30_Y16; Fanout = 2; COMB Node = 'Arkanoid:inst|Add5~1'
Info: 37: + IC(0.000 ns) + CELL(0.458 ns) = 12.292 ns; Loc. = LAB_X30_Y16; Fanout = 1; COMB Node = 'Arkanoid:inst|Add5~2'
Info: 38: + IC(0.745 ns) + CELL(0.521 ns) = 13.558 ns; Loc. = LAB_X31_Y13; Fanout = 16; COMB Node = 'Arkanoid:inst|platform2_position~48'
Info: 39: + IC(1.362 ns) + CELL(0.517 ns) = 15.437 ns; Loc. = LAB_X27_Y14; Fanout = 2; COMB Node = 'Arkanoid:inst|Add7~3'
Info: 40: + IC(0.000 ns) + CELL(0.458 ns) = 15.895 ns; Loc. = LAB_X27_Y14; Fanout = 15; COMB Node = 'Arkanoid:inst|Add7~4'
Info: 41: + IC(0.709 ns) + CELL(0.517 ns) = 17.121 ns; Loc. = LAB_X26_Y14; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~5'
Info: 42: + IC(0.000 ns) + CELL(0.080 ns) = 17.201 ns; Loc. = LAB_X26_Y14; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~7'
Info: 43: + IC(0.000 ns) + CELL(0.080 ns) = 17.281 ns; Loc. = LAB_X26_Y14; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~9'
Info: 44: + IC(0.000 ns) + CELL(0.080 ns) = 17.361 ns; Loc. = LAB_X26_Y14; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~11'
Info: 45: + IC(0.000 ns) + CELL(0.080 ns) = 17.441 ns; Loc. = LAB_X26_Y14; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~13'
Info: 46: + IC(0.000 ns) + CELL(0.080 ns) = 17.521 ns; Loc. = LAB_X26_Y14; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~15'
Info: 47: + IC(0.000 ns) + CELL(0.080 ns) = 17.601 ns; Loc. = LAB_X26_Y14; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~17'
Info: 48: + IC(0.000 ns) + CELL(0.080 ns) = 17.681 ns; Loc. = LAB_X26_Y14; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~19'
Info: 49: + IC(0.000 ns) + CELL(0.080 ns) = 17.761 ns; Loc. = LAB_X26_Y14; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~21'
Info: 50: + IC(0.000 ns) + CELL(0.080 ns) = 17.841 ns; Loc. = LAB_X26_Y14; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~23'
Info: 51: + IC(0.000 ns) + CELL(0.080 ns) = 17.921 ns; Loc. = LAB_X26_Y14; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~25'
Info: 52: + IC(0.000 ns) + CELL(0.080 ns) = 18.001 ns; Loc. = LAB_X26_Y14; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~27'
Info: 53: + IC(0.000 ns) + CELL(0.080 ns) = 18.081 ns; Loc. = LAB_X26_Y14; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~29'
Info: 54: + IC(0.000 ns) + CELL(0.080 ns) = 18.161 ns; Loc. = LAB_X26_Y14; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~31'
Info: 55: + IC(0.098 ns) + CELL(0.080 ns) = 18.339 ns; Loc. = LAB_X26_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~33'
Info: 56: + IC(0.000 ns) + CELL(0.080 ns) = 18.419 ns; Loc. = LAB_X26_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~35'
Info: 57: + IC(0.000 ns) + CELL(0.080 ns) = 18.499 ns; Loc. = LAB_X26_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~37'
Info: 58: + IC(0.000 ns) + CELL(0.080 ns) = 18.579 ns; Loc. = LAB_X26_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~39'
Info: 59: + IC(0.000 ns) + CELL(0.080 ns) = 18.659 ns; Loc. = LAB_X26_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~41'
Info: 60: + IC(0.000 ns) + CELL(0.080 ns) = 18.739 ns; Loc. = LAB_X26_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~43'
Info: 61: + IC(0.000 ns) + CELL(0.080 ns) = 18.819 ns; Loc. = LAB_X26_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~45'
Info: 62: + IC(0.000 ns) + CELL(0.080 ns) = 18.899 ns; Loc. = LAB_X26_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~47'
Info: 63: + IC(0.000 ns) + CELL(0.080 ns) = 18.979 ns; Loc. = LAB_X26_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~49'
Info: 64: + IC(0.000 ns) + CELL(0.080 ns) = 19.059 ns; Loc. = LAB_X26_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~51'
Info: 65: + IC(0.000 ns) + CELL(0.080 ns) = 19.139 ns; Loc. = LAB_X26_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~53'
Info: 66: + IC(0.000 ns) + CELL(0.080 ns) = 19.219 ns; Loc. = LAB_X26_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~55'
Info: 67: + IC(0.000 ns) + CELL(0.080 ns) = 19.299 ns; Loc. = LAB_X26_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~57'
Info: 68: + IC(0.000 ns) + CELL(0.080 ns) = 19.379 ns; Loc. = LAB_X26_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~59'
Info: 69: + IC(0.000 ns) + CELL(0.080 ns) = 19.459 ns; Loc. = LAB_X26_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|LessThan139~61'
Info: 70: + IC(0.000 ns) + CELL(0.458 ns) = 19.917 ns; Loc. = LAB_X26_Y13; Fanout = 3; COMB Node = 'Arkanoid:inst|LessThan139~62'
Info: 71: + IC(0.763 ns) + CELL(0.521 ns) = 21.201 ns; Loc. = LAB_X26_Y11; Fanout = 9; COMB Node = 'Arkanoid:inst|always2~5'
Info: 72: + IC(1.739 ns) + CELL(0.495 ns) = 23.435 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~1'
Info: 73: + IC(0.000 ns) + CELL(0.080 ns) = 23.515 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~3'
Info: 74: + IC(0.000 ns) + CELL(0.080 ns) = 23.595 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~5'
Info: 75: + IC(0.000 ns) + CELL(0.080 ns) = 23.675 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~7'
Info: 76: + IC(0.000 ns) + CELL(0.080 ns) = 23.755 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~9'
Info: 77: + IC(0.000 ns) + CELL(0.080 ns) = 23.835 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~11'
Info: 78: + IC(0.000 ns) + CELL(0.080 ns) = 23.915 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~13'
Info: 79: + IC(0.000 ns) + CELL(0.080 ns) = 23.995 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~15'
Info: 80: + IC(0.000 ns) + CELL(0.080 ns) = 24.075 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~17'
Info: 81: + IC(0.000 ns) + CELL(0.080 ns) = 24.155 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~19'
Info: 82: + IC(0.000 ns) + CELL(0.080 ns) = 24.235 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~21'
Info: 83: + IC(0.000 ns) + CELL(0.080 ns) = 24.315 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~23'
Info: 84: + IC(0.000 ns) + CELL(0.080 ns) = 24.395 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~25'
Info: 85: + IC(0.000 ns) + CELL(0.080 ns) = 24.475 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~27'
Info: 86: + IC(0.000 ns) + CELL(0.080 ns) = 24.555 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~29'
Info: 87: + IC(0.000 ns) + CELL(0.080 ns) = 24.635 ns; Loc. = LAB_X13_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~31'
Info: 88: + IC(0.098 ns) + CELL(0.080 ns) = 24.813 ns; Loc. = LAB_X13_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~33'
Info: 89: + IC(0.000 ns) + CELL(0.080 ns) = 24.893 ns; Loc. = LAB_X13_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~35'
Info: 90: + IC(0.000 ns) + CELL(0.080 ns) = 24.973 ns; Loc. = LAB_X13_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~37'
Info: 91: + IC(0.000 ns) + CELL(0.080 ns) = 25.053 ns; Loc. = LAB_X13_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~39'
Info: 92: + IC(0.000 ns) + CELL(0.080 ns) = 25.133 ns; Loc. = LAB_X13_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|Add9~41'
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Info: 162: + IC(0.000 ns) + CELL(0.080 ns) = 48.184 ns; Loc. = LAB_X20_Y17; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_7_result_int[4]~7'
Info: 163: + IC(0.000 ns) + CELL(0.080 ns) = 48.264 ns; Loc. = LAB_X20_Y17; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_7_result_int[5]~9'
Info: 164: + IC(0.000 ns) + CELL(0.458 ns) = 48.722 ns; Loc. = LAB_X20_Y17; Fanout = 16; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_7_result_int[6]~10'
Info: 165: + IC(1.396 ns) + CELL(0.177 ns) = 50.295 ns; Loc. = LAB_X16_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|StageOut[42]~145'
Info: 166: + IC(1.084 ns) + CELL(0.495 ns) = 51.874 ns; Loc. = LAB_X16_Y17; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_8_result_int[1]~1'
Info: 167: + IC(0.000 ns) + CELL(0.080 ns) = 51.954 ns; Loc. = LAB_X16_Y17; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_8_result_int[2]~3'
Info: 168: + IC(0.000 ns) + CELL(0.080 ns) = 52.034 ns; Loc. = LAB_X16_Y17; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_8_result_int[3]~5'
Info: 169: + IC(0.000 ns) + CELL(0.080 ns) = 52.114 ns; Loc. = LAB_X16_Y17; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_8_result_int[4]~7'
Info: 170: + IC(0.000 ns) + CELL(0.080 ns) = 52.194 ns; Loc. = LAB_X16_Y17; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_8_result_int[5]~9'
Info: 171: + IC(0.000 ns) + CELL(0.458 ns) = 52.652 ns; Loc. = LAB_X16_Y17; Fanout = 16; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_8_result_int[6]~10'
Info: 172: + IC(1.393 ns) + CELL(0.177 ns) = 54.222 ns; Loc. = LAB_X13_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|StageOut[48]~153'
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Info: 174: + IC(0.000 ns) + CELL(0.080 ns) = 55.836 ns; Loc. = LAB_X16_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_9_result_int[2]~3'
Info: 175: + IC(0.000 ns) + CELL(0.080 ns) = 55.916 ns; Loc. = LAB_X16_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_9_result_int[3]~5'
Info: 176: + IC(0.000 ns) + CELL(0.080 ns) = 55.996 ns; Loc. = LAB_X16_Y15; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_9_result_int[4]~7'
Info: 177: + IC(0.000 ns) + CELL(0.080 ns) = 56.076 ns; Loc. = LAB_X16_Y15; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_9_result_int[5]~9'
Info: 178: + IC(0.000 ns) + CELL(0.458 ns) = 56.534 ns; Loc. = LAB_X16_Y15; Fanout = 16; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_9_result_int[6]~10'
Info: 179: + IC(0.940 ns) + CELL(0.319 ns) = 57.793 ns; Loc. = LAB_X16_Y17; Fanout = 3; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|StageOut[57]~339'
Info: 180: + IC(1.680 ns) + CELL(0.517 ns) = 59.990 ns; Loc. = LAB_X11_Y15; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_10_result_int[4]~7'
Info: 181: + IC(0.000 ns) + CELL(0.080 ns) = 60.070 ns; Loc. = LAB_X11_Y15; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_10_result_int[5]~9'
Info: 182: + IC(0.000 ns) + CELL(0.458 ns) = 60.528 ns; Loc. = LAB_X11_Y15; Fanout = 16; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_10_result_int[6]~10'
Info: 183: + IC(0.914 ns) + CELL(0.319 ns) = 61.761 ns; Loc. = LAB_X16_Y15; Fanout = 3; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|StageOut[63]~341'
Info: 184: + IC(1.015 ns) + CELL(0.517 ns) = 63.293 ns; Loc. = LAB_X13_Y15; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_11_result_int[4]~7'
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Info: 186: + IC(0.000 ns) + CELL(0.458 ns) = 63.831 ns; Loc. = LAB_X13_Y15; Fanout = 16; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_11_result_int[6]~10'
Info: 187: + IC(1.040 ns) + CELL(0.177 ns) = 65.048 ns; Loc. = LAB_X9_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|StageOut[66]~177'
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Info: 189: + IC(0.000 ns) + CELL(0.080 ns) = 66.661 ns; Loc. = LAB_X11_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_12_result_int[2]~3'
Info: 190: + IC(0.000 ns) + CELL(0.080 ns) = 66.741 ns; Loc. = LAB_X11_Y15; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_12_result_int[3]~5'
Info: 191: + IC(0.000 ns) + CELL(0.080 ns) = 66.821 ns; Loc. = LAB_X11_Y15; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_12_result_int[4]~7'
Info: 192: + IC(0.000 ns) + CELL(0.080 ns) = 66.901 ns; Loc. = LAB_X11_Y15; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_12_result_int[5]~9'
Info: 193: + IC(0.000 ns) + CELL(0.458 ns) = 67.359 ns; Loc. = LAB_X11_Y15; Fanout = 16; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_12_result_int[6]~10'
Info: 194: + IC(0.894 ns) + CELL(0.319 ns) = 68.572 ns; Loc. = LAB_X13_Y15; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|StageOut[76]~344'
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Info: 196: + IC(0.000 ns) + CELL(0.458 ns) = 70.563 ns; Loc. = LAB_X10_Y15; Fanout = 16; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_13_result_int[6]~10'
Info: 197: + IC(1.038 ns) + CELL(0.177 ns) = 71.778 ns; Loc. = LAB_X12_Y15; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|StageOut[82]~186'
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Info: 223: + IC(0.000 ns) + CELL(0.458 ns) = 86.070 ns; Loc. = LAB_X9_Y12; Fanout = 16; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_18_result_int[6]~10'
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Info: 229: + IC(0.000 ns) + CELL(0.080 ns) = 88.598 ns; Loc. = LAB_X11_Y12; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_19_result_int[5]~9'
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Info: 231: + IC(1.089 ns) + CELL(0.177 ns) = 90.322 ns; Loc. = LAB_X10_Y9; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|StageOut[114]~241'
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Info: 235: + IC(0.000 ns) + CELL(0.080 ns) = 91.555 ns; Loc. = LAB_X10_Y9; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_20_result_int[4]~7'
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Info: 242: + IC(0.000 ns) + CELL(0.458 ns) = 95.560 ns; Loc. = LAB_X11_Y9; Fanout = 16; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_21_result_int[6]~10'
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Info: 248: + IC(0.681 ns) + CELL(0.544 ns) = 99.846 ns; Loc. = LAB_X11_Y9; Fanout = 3; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|StageOut[134]~260'
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Info: 287: + IC(0.000 ns) + CELL(0.458 ns) = 125.051 ns; Loc. = LAB_X16_Y12; Fanout = 13; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_30_result_int[6]~10'
Info: 288: + IC(0.365 ns) + CELL(0.544 ns) = 125.960 ns; Loc. = LAB_X15_Y12; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|StageOut[182]~324'
Info: 289: + IC(1.060 ns) + CELL(0.517 ns) = 127.537 ns; Loc. = LAB_X16_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_31_result_int[3]~5'
Info: 290: + IC(0.000 ns) + CELL(0.080 ns) = 127.617 ns; Loc. = LAB_X16_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_31_result_int[4]~7'
Info: 291: + IC(0.000 ns) + CELL(0.080 ns) = 127.697 ns; Loc. = LAB_X16_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_31_result_int[5]~9'
Info: 292: + IC(0.000 ns) + CELL(0.458 ns) = 128.155 ns; Loc. = LAB_X16_Y13; Fanout = 3; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|alt_u_div_k2f:divider|add_sub_31_result_int[6]~10'
Info: 293: + IC(1.369 ns) + CELL(0.517 ns) = 130.041 ns; Loc. = LAB_X18_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~1'
Info: 294: + IC(0.000 ns) + CELL(0.080 ns) = 130.121 ns; Loc. = LAB_X18_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~3'
Info: 295: + IC(0.000 ns) + CELL(0.080 ns) = 130.201 ns; Loc. = LAB_X18_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~5'
Info: 296: + IC(0.000 ns) + CELL(0.080 ns) = 130.281 ns; Loc. = LAB_X18_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~7'
Info: 297: + IC(0.000 ns) + CELL(0.080 ns) = 130.361 ns; Loc. = LAB_X18_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~9'
Info: 298: + IC(0.000 ns) + CELL(0.080 ns) = 130.441 ns; Loc. = LAB_X18_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~11'
Info: 299: + IC(0.000 ns) + CELL(0.080 ns) = 130.521 ns; Loc. = LAB_X18_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~13'
Info: 300: + IC(0.000 ns) + CELL(0.080 ns) = 130.601 ns; Loc. = LAB_X18_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~15'
Info: 301: + IC(0.000 ns) + CELL(0.080 ns) = 130.681 ns; Loc. = LAB_X18_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~17'
Info: 302: + IC(0.000 ns) + CELL(0.080 ns) = 130.761 ns; Loc. = LAB_X18_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~19'
Info: 303: + IC(0.000 ns) + CELL(0.080 ns) = 130.841 ns; Loc. = LAB_X18_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~21'
Info: 304: + IC(0.000 ns) + CELL(0.080 ns) = 130.921 ns; Loc. = LAB_X18_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~23'
Info: 305: + IC(0.000 ns) + CELL(0.080 ns) = 131.001 ns; Loc. = LAB_X18_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~25'
Info: 306: + IC(0.000 ns) + CELL(0.080 ns) = 131.081 ns; Loc. = LAB_X18_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~27'
Info: 307: + IC(0.000 ns) + CELL(0.080 ns) = 131.161 ns; Loc. = LAB_X18_Y11; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~29'
Info: 308: + IC(0.098 ns) + CELL(0.080 ns) = 131.339 ns; Loc. = LAB_X18_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~31'
Info: 309: + IC(0.000 ns) + CELL(0.080 ns) = 131.419 ns; Loc. = LAB_X18_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~33'
Info: 310: + IC(0.000 ns) + CELL(0.080 ns) = 131.499 ns; Loc. = LAB_X18_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~35'
Info: 311: + IC(0.000 ns) + CELL(0.080 ns) = 131.579 ns; Loc. = LAB_X18_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~37'
Info: 312: + IC(0.000 ns) + CELL(0.080 ns) = 131.659 ns; Loc. = LAB_X18_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~39'
Info: 313: + IC(0.000 ns) + CELL(0.080 ns) = 131.739 ns; Loc. = LAB_X18_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~41'
Info: 314: + IC(0.000 ns) + CELL(0.080 ns) = 131.819 ns; Loc. = LAB_X18_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~43'
Info: 315: + IC(0.000 ns) + CELL(0.080 ns) = 131.899 ns; Loc. = LAB_X18_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~45'
Info: 316: + IC(0.000 ns) + CELL(0.080 ns) = 131.979 ns; Loc. = LAB_X18_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~47'
Info: 317: + IC(0.000 ns) + CELL(0.080 ns) = 132.059 ns; Loc. = LAB_X18_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~49'
Info: 318: + IC(0.000 ns) + CELL(0.080 ns) = 132.139 ns; Loc. = LAB_X18_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~51'
Info: 319: + IC(0.000 ns) + CELL(0.458 ns) = 132.597 ns; Loc. = LAB_X18_Y10; Fanout = 1; COMB Node = 'Arkanoid:inst|lpm_divide:Div0|lpm_divide_7so:auto_generated|abs_divider_kbg:divider|op_1~52'
Info: 320: + IC(0.732 ns) + CELL(0.178 ns) = 133.507 ns; Loc. = LAB_X19_Y10; Fanout = 2; COMB Node = 'Arkanoid:inst|Equal6~2'
Info: 321: + IC(0.131 ns) + CELL(0.545 ns) = 134.183 ns; Loc. = LAB_X19_Y10; Fanout = 1; COMB Node = 'Arkanoid:inst|Equal6~3'
Info: 322: + IC(0.354 ns) + CELL(0.322 ns) = 134.859 ns; Loc. = LAB_X19_Y10; Fanout = 1; COMB Node = 'Arkanoid:inst|Equal6~7'
Info: 323: + IC(1.034 ns) + CELL(0.544 ns) = 136.437 ns; Loc. = LAB_X15_Y13; Fanout = 5; COMB Node = 'Arkanoid:inst|Equal6~24'
Info: 324: + IC(0.131 ns) + CELL(0.545 ns) = 137.113 ns; Loc. = LAB_X15_Y13; Fanout = 4; COMB Node = 'Arkanoid:inst|WideNor0~4'
Info: 325: + IC(0.131 ns) + CELL(0.545 ns) = 137.789 ns; Loc. = LAB_X15_Y13; Fanout = 3; COMB Node = 'Arkanoid:inst|WideOr0~0'
Info: 326: + IC(0.723 ns) + CELL(0.521 ns) = 139.033 ns; Loc. = LAB_X10_Y13; Fanout = 1; COMB Node = 'Arkanoid:inst|high~8'
Info: 327: + IC(0.000 ns) + CELL(0.096 ns) = 139.129 ns; Loc. = LAB_X10_Y13; Fanout = 1; REG Node = 'Arkanoid:inst|hex3_[5]'
Info: Total cell delay = 67.965 ns ( 48.85 % )
Info: Total interconnect delay = 71.164 ns ( 51.15 % )
Info: Fitter routing operations beginning
Info: Average interconnect usage is 13% of the available device resources
Info: Peak interconnect usage is 26% of the available device resources in the region that extends from location X25_Y14 to location X37_Y27
Info: Fitter routing operations ending: elapsed time is 00:00:08
Info: The Fitter performed an Auto Fit compilation. Optimizations were skipped to reduce compilation time.
Info: Optimizations that may affect the design's routability were skipped
Info: Optimizations that may affect the design's timing were skipped
Info: Started post-fitting delay annotation
Warning: Found 50 output pins without output pin load capacitance assignment
Info: Pin "h_sync" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "v_sync" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "blue[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "blue[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "blue[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "blue[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "green[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "green[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "green[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "green[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex0[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex0[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex0[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex0[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex0[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex0[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex0[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex1[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex1[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex1[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex1[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex1[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex1[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex1[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex2[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex2[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex2[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex2[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex2[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex2[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex2[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex3[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex3[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex3[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex3[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex3[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex3[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "hex3[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "led[7]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "led[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "led[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "led[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "led[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "led[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "led[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "led[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "red[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "red[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "red[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Pin "red[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Delay annotation completed successfully
Warning: The Reserve All Unused Pins setting has not been specified, and will default to 'As output driving ground'.
Info: Generated suppressed messages file G:/Verilog/Arkanoid2PDE1/myArkanoid.fit.smsg
Info: Quartus II Fitter was successful. 0 errors, 2 warnings
Info: Peak virtual memory: 266 megabytes
Info: Processing ended: Mon May 28 14:22:27 2012
Info: Elapsed time: 00:00:28
Info: Total CPU time (on all processors): 00:00:31
+----------------------------+
; Fitter Suppressed Messages ;
+----------------------------+
The suppressed messages can be found in G:/Verilog/Arkanoid2PDE1/myArkanoid.fit.smsg.
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